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A Dynamically Reconfigurable Multi-ASIP Architecture for Multistandard and Multimode Turbo Decoding

Vianney Lapotre 1 Purushotham Murugappa Velayuthan 2 Guy Gogniat 1 Amer Baghdadi 3, 2 Michael Hübner 4 Jean-Philippe Diguet 1
1 Lab-STICC_UBS_CACS_MOCS
Lab-STICC - Laboratoire des sciences et techniques de l'information, de la communication et de la connaissance
2 Lab-STICC_TB_CACS_IAS
Lab-STICC - Laboratoire des sciences et techniques de l'information, de la communication et de la connaissance
Abstract : The multiplication of wireless communication standards is introducing the need of flexible and reconfigurable multistandard baseband receivers. In this context, multiprocessor turbo decoders have been recently developed in order to support the increasing flexibility and throughput requirements of emerging applications. However, these solutions do not sufficiently address reconfiguration performance issues, which can be a limiting factor in the future. This brief presents the design of a reconfigurable multiprocessor architecture for turbo decoding achieving very fast reconfiguration without compromising the decoding performances.
Type de document :
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Liste complète des métadonnées

https://hal.archives-ouvertes.fr/hal-01121754
Contributeur : Vianney Lapôtre <>
Soumis le : jeudi 25 février 2021 - 18:37:55
Dernière modification le : lundi 17 mai 2021 - 11:24:01
Archivage à long terme le : : mercredi 26 mai 2021 - 19:17:53

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TVLSI_brief.pdf
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Citation

Vianney Lapotre, Purushotham Murugappa Velayuthan, Guy Gogniat, Amer Baghdadi, Michael Hübner, et al.. A Dynamically Reconfigurable Multi-ASIP Architecture for Multistandard and Multimode Turbo Decoding. IEEE Transactions on Very Large Scale Integration (VLSI) Systems, IEEE, 2016, 24 (1), pp.383 - 387. ⟨10.1109/TVLSI.2015.2396941⟩. ⟨hal-01121754⟩

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