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| HAL: hal-00202772, version 2 |
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| Available versions: | v2 (2008-01-08) |
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| Exploitation optimale des circuits reconfigurables FPGA pour la mise en oeuvre d'un moteur de recherche de motifs |
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| Yapi Georges Adouko 1François Charot 1 |
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| (2008-01-08) |
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| Nous proposons une implémentation matérielle d'un moteur de recherche de motifs inspirée de l'algorithme de Aho-Corasick, conçue pour exploiter de manière optimale les circuits reprogrammables de type FPGA et adaptée aux grandes bases de motifs (plusieurs dizaines de milliers de motifs) comme celles d'un système de détection d'intrusion tel que Snort. Nous présentons les idées qui ont guidé nos travaux et décrivons la méthodologie de mise en oeuvre. Nous montrons comment, en utilisant la parallélisation de trafic et le retiming de circuits, des débits de près de 40 Gbits/s peuvent être atteints. |
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| 1: | CAIRN (INRIA - IRISA) |
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INRIA – CNRS : UMR6074 – École normale supérieure de Cachan - ENS Cachan – Institut National des Sciences Appliquées (INSA) - Rennes – Université de Rennes 1 |
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| Subject | : | Computer Science/Architecture |
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| recherche de motifs – FPGA – détection d'intrusions |
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| Attached file list to this document: | |||||
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| hal-00202772, version 2 | |
| http://hal.archives-ouvertes.fr/hal-00202772 | |
| oai:hal.archives-ouvertes.fr:hal-00202772 | |
| From: Yapi Georges Morel Adouko | |
| Submitted on: Tuesday, 8 January 2008 13:29:54 | |
| Updated on: Tuesday, 27 January 2009 15:21:30 | |
